查询结果:   李小闯,于强.基于FPGA的变M/T归一化测速算法研究[J].计算机应用与软件,2019,36(9):122 - 126.
中文标题
基于FPGA的变M/T归一化测速算法研究
发表栏目
应用技术与研究
摘要点击数
43
英文标题
A MODIFIED M/T NORMALIZED VELOCITY MEASUREMENT ALGORITHM BASED ON FPGA
作 者
李小闯 于强 Li Xiaochuang Yu Qiang
作者单位
中国科学院国家空间科学中心 北京 100190 中国科学院大学 北京 100049    
英文单位
National Space Science Center, Chinese Academy of Sciences, Beijing 100190, China University of Chinese Academy of Sciences, Beijing 100049, China    
关键词
增量编码器 变M/T测速算法 归一化 Booth FPGA
Keywords
Incremental encoder Modified M/T measurement algorithm Normalized Booth FPGA
基金项目
国家重大科学仪器专项(2013YQ030595)
作者资料
李小闯,硕士生,主研领域:计算机应用。于强,研究员。 。
文章摘要
针对永磁同步电机的测速问题,提出关于增量编码器的变M/T归一化测速算法,并基于Xilinx FPGA板级系统完成算法设计与实现。通过分析M/T算法在低速范围的局限性,添加速度预测单元实时指导计数脉冲个数选取。为便于算法移植,在算法中引入归一化的设计思想。针对算法中使用较多的乘法器,引入Booth算法降低整体算法设计对FPGA片内DSP的依赖性。仿真结果表明,基于FPGA的变M/T归一化测速算法转速测量误差在±0.4 r/min内,测速响应时间不超过3 ms。
Abstract
Aiming at the problem of speed measurement of permanent magnet synchronous motor, this paper presented a modified M/T normalized speed measurement algorithm for incremental encoder, and completed the design and implementation of the algorithm based on Xilinx FPGA board-level system. By analyzing the limitation of M/T algorithm in the low speed range, a speed prediction unit was added to guide the selection of counting pulses in real time. In order to facilitate the transplantation of the algorithm, the idea of normalization was introduced into the algorithm. Booth algorithm was introduced to reduce the dependence of the whole algorithm design on the on-chip DSP for the multiplier used in the algorithm. The simulation results show that the speed measurement error of the modified M/T normalized speed measurement algorithm based on FPGA is within ±0.4 rad/min and the response time is less than 3 ms.
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摘要
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基于FPGA的变M/T归一化测速算法研究
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